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数字电子技术：ch05-3锁存器和触发器.ppt

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数字电子技术：ch05-3锁存器和触发器.ppt

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5.4 触发器的电路结构和工作原理

5.4.1 主从触发器 (D 型， S-R 型， J-K

型）

5.4.2 维持阻塞触发器（ D 型）

*5.4.3 利用传输延时的触发器（ J-K 型， S-R

型）

5.4.4 触发器的动态特性

5.4 触发器的电路结构和工作原理

1. 锁存器与触发器

锁存器在 E 的高 ( 低 ) 电平

期间对信号敏感

触发器在 CP 的上升沿 ( 下

降沿 ) 对信号敏感

在 VerilogHDL 中对锁存器与

触发器的描述语句是不同的

Q

主锁存器

从锁存器

Q

5.4 触发器的电路结构和工作原理

主锁存器与从锁存器结

构相同

1. 电路结构

5.4.1 主从型触发

器

和 TG

的工作状态相

同

和 TG

的工作状态相同

D 主从型触发器

D 锁存器 D 锁存器

2. 由传输门组成的 CMOS 边沿 D 触发器

工作原理：

导通， TG

断开——输入信号 D 送入主锁存器。

断开， TG

导通——从锁存器维持在原来的状态不变。

(1) CP=0 时 :

=1 ， C=0 ，

Q 跟随 D 端的状态变化，使 Q=D 。

Q

主锁存器

从锁存器

Q

工作原理：

(2) CP 由 0 跳变到 1 :

=0 ， C=1 ，

触发器的状态仅仅取决于 CP 信号上升沿到达前瞬间的 D 信号

导通， TG

断开——从锁存器 Q 的信号送 Q 端。

断开， TG

导通——输入信号 D 不能送入主锁存器。

主锁存器维持原态不变。

Q

主锁存器

从锁存器

Q

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