LATTICE非常详细的时序约束(中文教程).pdf

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网络转来的,方便大家使用, LATTICE 非常详细的时序约束(中文教程) FPGA时序约束
的概念 的设计规模越来越大,复杂程度日益增加,同时要求系统 也越来越高。 获得日标越来越困难 设计者必须采用各种技术提升系统性能以满足设计的 要求 Lattice aa Semiconductor Corporation More of the best 用合适的 进行适当的综合约束 管脚锁定 实施 布局布线 控制 Lattice aa Semiconductor c orporation More of the best 采用合适的 关于提升系统性能,工程师最容易想到的方法就是通过进行综合约束、布局布线约束、和其他 的优化技术提升系统性能,当然这些都是设计过程中所必需的,但所有这些优化方法对于系统性能的提升 都是有限的,系统的性能最终还是取决于工程师的设计( ),其中同步设计是最重要的一点 下面讨论一些具体的技术,合理的运用这些 技术能够尽可能的减小两级寄存器之间的延 时从而获得更高的系统速度 通用的 的设计:多个工程师可以同时参与到一个复杂设计中来 加速设计和编译过程:关键模块可以单独修改而不会影像整个设计。 缩短设计周期:重复利用成熟模块。 模块可以容易被L程师理解和维护 缺点:如果模块划分不合理,特别是模块边界设计处理不当会影响的资源利用率和最终 的系统性能。 Lattice aa Semiconductor Corporation More of the best 采用合适的 上述缺点可以通过细致的 设计来克服 需遵循的规则 模块仅仅应该包含 ,即在顶层模块中调用子 模块。 任何 应当包含在 模块中。 任何输入输出器件的信号应当在 模块中声明为 和 在 中 所有输出,以保证所有 之间为同步设计,获 得更好的系统 Lattice aa Semiconductor c orporation More of the best 采用合适的 E 保证相关逻辑和共享资源在同一个模块中实现 这样可以做到更好的资源共享,综合工具只能针对一定数量的逻辑进行优化; 综合工具可以在一个模块内部优化整个关键路径;跨模块的关键路径也不会被 有效的优化 Figure 56: Merge Sharable Resource in the Same Block B Lattice aa Semiconductor c orporation More of the best 采用合适的 针对不同地优化目标来划分模块 分离关键路径和非关键路径可以获得更好的综合效果。 没计者应该在充分考虑性能需求和资源需求的基础上进行逻辑设计针对不同 的模块采用不同的优化策略,以避免相互影响。 对于那些并不需要 的模块应该放松约束以节省和预留关键资源 给关键路径。 Figure 57: Logic with the Same Relaxation Constraint FFt FF2 Lattice Semiconductor i Corporation More of the best 采用合适的 在单独的模块中保存实例化代码 可以非常方便的在行为仿真模型和实际的块代码之际间进行切换 Figure 58: separate RAM Block op RAM Controller Register File state Machine oLlI 每个 的规模在 :小模块由于资源有限不利于综合工具实施 算法;规模太大的模块一旦更改其中的一小部分就会导致整个 模块重新综合,影响到一些不必要的逻辑,增大综合运行时问 利用流水设计提高系统性能,把一个较长的路径分割为多个短路径,并在多个 时钟周期完成 Lattice aa Semiconductor c orporation More of the best 采用合适的 Figure 59: Before Pipelining FF1 Comb Comb Comb FF1 Function Function Function Slow Clock Figure 60: After Pipelining FF1 Comb FF2 FF3 Comb FF4 Function Function Function Fast Clock 比较 生成优先级的编码逻辑 实现 逻辑 如果每个解码条件相对独立这两种声明方式实现的功能是一样的。 Lattice Semiconductor i Corporation More of the best

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yxf198216 先了解一下吧
2017-03-30
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OllieZhou 应该是官方的资料,很详细,不错
2015-10-27
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