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VHDL变速计数器
VHDL变速计数器
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VHDL变速计数器
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内核变速器
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可以变速,网络游戏之类的,也可以系统变速,不错的源码,可以学习一下
兄弟变速器的源码.zip_加速器源码_变速_变速器_变速器源码_变速源码
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兄弟变速器的源码
【最新】守望者变速齿轮源代码(游戏加速辅助)
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3星 · 编辑精心推荐
(用于改变时钟) 【2013.12月更新最新】守望者变速齿轮源代码(游戏加速辅助)
变速齿轮2.2 win10可用
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5星 · 资源好评率100%
变速齿轮2.2 win10可用。体验加速的感觉,支持几乎所有老游戏
变速齿轮 易语言源码 变速齿轮源码 变速器源码
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3星 · 编辑精心推荐
变速齿轮 易语言源码 变速齿轮源码 变速器源码 可以用于网络游戏
易语言 变速齿轮 源码
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3星 · 编辑精心推荐
变速齿轮源码变速齿轮源码变速齿轮源码变速齿轮源码变速齿轮源码变速齿轮源码变速齿轮源码变速齿轮源码
VHDL计数器
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5星 · 资源好评率100%
用VHDL写的计数器模块,可以在此基础上进行修改
计数器VHDL
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数字逻辑电路设计实验 用VHDL语言实现的计数器
计数器的VHDL设计
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多个常用计数器的VHDL描述。各种功能的计数器。
6进制计数器计数器 VHDL
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基于fpga,使用vhdl语言编写的6进制计数器。输入时钟为1hz
易语言源码易语言草帽变速齿轮源码.rar
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变速齿轮主程序源码.e
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这是变速齿轮源码,喜欢的可以下载哦。源码开发不易请善待,仅供学习,禁止商用,这个是最简单的编程登入器,希望能帮到你们
易语言版变速精灵源码
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易语言版变速精灵源码,通过注入HOOKAPI达到变速效果,
易语言守望者内核驱动变速
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易语言守望者内核驱动变速源码,守望者内核驱动变速,加载驱动_,卸载驱动_,CTL_CODE,十六到十,取驱动句柄,NtQuerySystemInformation,LocalAlloc,LocalFree,SYSTEM_MODULE_INFORMATION,LoadLibraryEx,FreeLibrary,GetProcAddress,OpenSCManagerA,DeleteService,C
变速齿轮源码
浏览:78
5星 · 资源好评率100%
这是一个变速齿轮的源码 感谢 同学老周同志的测试与支持,他可能是除我以外第一个用户。 也感谢作者李维自己的努力,和所有关心支持本软件的同志。
VHDL做的彩灯和计数器
浏览:138
通过用VHDL语言设计各个模块,然后把各个模块生成原理图,再把各个模块组合起来,以实现能两位动态显示(串行)16进制减法器,并总体仿真及加载内部连接网线、总线定义引脚,下载到硬件实现它的功能。 通过自己个人去探索,按照自顶向下的设计方法,一个有4种显示模式的彩灯控制器。可通过按扭选择根据时钟控制四种模式循环变化,每种模式工作3秒。并可通过按扭选择、设置4种模式中的一种工作模式运行。
用VHDL编写计数器
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4星 · 用户满意度95%
用VHDL描写计数器,0-999 一、题目要求: 输出为3位BCD码的计数显示电路。该计数显示电路由三个模块构成: 1、十进制计数器(BCD_CNT) 2、七段显示译码器电路(DEC_LED) 3、分时总线切换电路(SCAN)
计数器 VHDL代码 BUPT
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用VHDL写的计时器,数字电路与逻辑设计实验 原创
十进制计数器VHDL
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通过VHDL,实现10位带使能计数器。 LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_UNSIGNED.ALL; ENTITY CNT10 IS PORT(CLK_IN: IN STD_LOGIC; COUT228 : OUT STD_LOGIC); --计数进位输出 END CNT
计数器 VHDL源代码
浏览:73
4星 · 用户满意度95%
计数器 VHDL源代码
变速齿轮源码+模块
浏览:132
4星 · 用户满意度95%
易语言变速齿轮源码,带模块,都找不到模块,终于被我找打了,这个带模块的
莫言变速齿轮DLL+EC+例程=完整源码
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4星 · 用户满意度95%
DNF加速源码、
变速精灵(原变速兄弟)
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变速精灵是一款电脑加速软件,最高可加速256倍,微调精度达到0.001位。采用纯软件方式变速,不会损害电脑硬件支持热键变速
易语言草帽变速齿轮源码-易语言
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易语言草帽变速齿轮源码
守望者内核驱动变速易语言源码-易语言
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守望者内核驱动变速易语言源码
VHDL 0-99计数器
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5星 · 资源好评率100%
用VHDL实现0-99计数并在两个数码数码管上显示出来。
cnt10_VHDL;计数器_gasmdn_
浏览:8
VHDL语言实现的计数器,可以数到10。
VHDL 999计数器
浏览:183
5星 · 资源好评率100%
VHDL 999计数器,用VHDL语言编写
VHDL 自启动七进制计数器
浏览:190
VHDL 自启动七进制计数器
收起资源包目录
VHDL-Variable-Speed-Counter-master.zip
(11个子文件)
VHDL-Variable-Speed-Counter-master
src
Nexys4DDR_Master.xdc
19KB
display_multiplexer.vhd
3KB
frequency_modifier.vhd
2KB
BCD_to_7SEG.vhd
1KB
clock_divider.vhd
2KB
debouncer.vhd
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display_clock_div.vhd
2KB
counter.vhd
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