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论文研究-基于CPLD的LCD控制器设计 .pdf 评分

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取国科技论在线 5taF七 线性*计数降《含有上下 半屏*迁计款和开婚七 数果|MA[a.15 安存器) BUSY DIN 计数跟 FLM CLK/分计暑 CPUC-K L二N a+ A fao ME网 AL 时钟发生 √CLK 驱动部 十zLL 非门 MRD R DIN 或4门 MWR 控制器设计 是整个系统的时钟信号 高电平时,读上半屏的八位数据 低电平 时,读下半屏的八位数据,用来实现上下半屏的数据的同时刷新。行同步信号是 的倍,由系统时钟产生。在的控制下,由驱动部分把八位数据并行移出。 刷新速度的计算公式为 式中,为显示系统显示帧扫描频率,一般要大于 为系统的工作时钟 为字体的水平点数,×为显示系统的水平点数,是因为一行显示完成后,还要等 待个字的时间用来换行;为显小系统的行数+ 总结 本文设计是一个通用的控制系统,可以根据实际应用的具体环境情况选择对应的 ,根据的技术参数确定其显示时序,进而进行整个显示系统设计。设计中选用 芯片,米用 使件描述语言,对显小屏系统的逻辑控制系统进行了优化设计。在 设计电峂结构时,充分考虑了编制控制程序的方使。设计的逻辑控制系统结构适用于不同面 积大小的显示屏系统。 参考文献 郭强应用技术电子工业出版社,年月 卢毅、赖杰编 与数字电路设计科学出版社 年月 沃拓军、陈志良驱动控制时钟电路的设计微电子学 郭强利用技术设计液晶显示控訇器现代显示 陈静,姚清玉用搾制器实现显示屏的制现代显示 廖裕评、陆瑞强数字电路设计清华大学出版社: 牛 取国科技论在线

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