论文研究-基于VHDL和CPLD实现的HDB3编码器 .pdf

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基于VHDL和CPLD实现的HDB3编码器,王珏,,文章通过对HDB3编码器的原理分析,提出了一种基于CPLD技术的HDB3编码器的快速实现方法。此实现方法具有硬件设计简单、运行速度快、成
山国科技论文在线 电路仿真结果 本设计是在 Ⅱ的开发平台下,运用 语言编程仿貞,并通过 下载电缆将数据下载到 进行实际电路测试。其仿真结果是在输入为二进制 码流为 的情况下所得,如图所 3 4口 -o data out1 0 a ls ign o Ha pn2aosoDasoo0dsasoeoasox 图 图中的为系统所用全局时钟,输出的 再经过 实现由单极性到义极性的转换。因为在 编码器中要进行连“”检测,需要用到 级移位奇存器,因而在图中输出相对于输入延时了五个脉冲周期 总结 π编程逻辑器件大大节省了电路版面,编程时可先择加密,使芯片内部犹如一个黑匣子 提高了电路均稳定性及保密性。此外,在计算机上进行仿真与调式可克服硬件组装之后再进 行调试的弊端。改计人员降问题的解决放在件组装之前,这样既可以简化设十过程,又可 以减少设计风险及成本,缩短设计周期。本文讨论的 编译码方案具有硬件设计简单 实用,成本低等特点,同吋由于器件可以通过端冂的在线编程,因而可以改变 内部的控制程序以达到设计目的。实践表明,运用实现编码器与采用 专用集成电路相比,不仅给调试带来方便,而且可以把该电路及其他电路集成在同一块 芯片中,减少了外接元件,提高了系统集成度。本章的设计用 语言实现一个 码编码器,作为一个独立的模块,为片上系统的实现打下了基础 参考文献 [1樊昌信,张市诩,徐炳祥,通信原理.第5版,北京:国防工业出版社,2002,96-100 [2宋万杰等,CPLD技术及其应用,西安:电子科技大学出版社,19,193-198 [3ˉ段吉海,黄智伟,基于CPLD/FPGA的数字系统建模与设计,北京:电子工业出版社,2004 山国科技论文在线 VHDL HDB3 CPLD Max+Plus Il

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2019-08-17
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