针对多级串联模拟电路的可测性设计技术

所需积分/C币:5 2020-08-12 01:48:48 457KB PDF
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随着集成电路的发展,测试难度的增加,可测试性设计也越来越重要。针对串联结构的模拟电路提出一种可测性设计结构,该结构大大提高了电路内系统模块的可测试性,减少了需要额外引出的I/ O 数,同时不随内部模块数的增加而增加,并且可以与数字电路的边界扫描技术相兼容,通过在Cadence 下仿真,证明了该结构简单有效。

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2020-08-12
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