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基于FPGA的全数字时钟生成方法
基于FPGA的全数字时钟生成方法
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基于FPGA的全数字时钟生成方法
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基于FPGA的全数字时钟生成方法-论文
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基于FPGA的全数字时钟生成方法
基于FPGA的GPS时钟驯服电路设计与实现
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为满足系统对高精度时钟的要求，根据晶振时钟无随机误差和全球定位系统（GPS）时钟无累计误差的特点，提出了一种利用GPS 秒时钟驯服晶振时钟来实现高精度时钟的方案。该方案根据数字锁相环倍频原理，通过测量GPS 秒时钟和本地生成秒时钟的相位误差来调整电路分频比，实时消除晶振时钟的累计误差，从而实现高精度的系统时钟。经实际验证，该方法在使用16.369 M 温补晶振时，在GPS 信号有效情况下输出时钟误
南京理工大学 2018电类综合实验QuartusII设计源文件 基于QuartusII的多功能数字时钟设计
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使用qurtusII 9.1设计并下载到SmartSOPC...5． 根据EDA实验开发系统上的FPGA芯片进行适配，生成配置文件或JEDEC文件。 6． 将配置文件或JEDEC文件下载到EDA实验开发系统。 7． 在EDA实验开发系统上调试、验证电路功能。
南京理工大学 2018研究生电类综合实验报告 基于QuartusII的多功能数字时钟设计(50页）
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本实验利用QuartusII软件，结合所学的...5． 根据EDA实验开发系统上的FPGA芯片进行适配，生成配置文件或JEDEC文件。 6． 将配置文件或JEDEC文件下载到EDA实验开发系统。 7． 在EDA实验开发系统上调试、验证电路功能。
一种基于FPGA的真随机数生成器的设计 (2009年)
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针对当前真随机数生成器（TRNG）中存在资源开销大、可移植性差的问题，设计了一种利用数字电路时钟抖动以及相位漂移工作的TRNG。TRNG以多组反相器振荡环路作为随机源，使用线性反馈移位寄存器（LFSR）实现后处理。在...
用FPGA实现宽带信号的可靠传输
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然后给出了基于RocketIO GTX的高速数据可靠传输方案，其单路传输速率可达6Gbps，采用内嵌时钟技术简化了电路设计，并利用差错控制编码进一步降低了误码率。最后，搭建了具体的硬件平台，对方案进行了相应的实验测试...
基于双时钟的无滤波器数字D类音频放大器的扩频调制方法
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提出了一种基于双时钟的扩频调制方法，解决了无滤波器数字D类音频放大器电磁干扰大的问题。 此方法可用于统一脉冲宽度调制（UPWM）类型的无滤波器数字D类音频放大器。 对于此方法，UPWM信号的两个不同的脉冲重复频率...
基于FPGA可编程振荡器增强
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当今复杂的 FPGA 含有众多用于实现各种电路与系统的功能块，诸如逻辑阵列、存储器、DSP 模块、处理器、用于时序生成的锁相环 (PLL) 和延迟锁定环 (DLL)、标准 I/O、高速数字收发器以及并行接口（PCI、DDR 等）。...
EDA/PLD中的基于FPGA的任意波形发生器设计与研究
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任意波形发生器的实现方案主要有程序控制输出、DMA 输出、可变时钟计数器寻址和直接数字频率合成（ DDS） 等多种方式 。目前任意波形发生器的研制主要基于DDS 技术， 与传统的频率合成器相比， DDS 具有低成本、低...
如何使用FPGA实现步进电机控制器
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介绍基于FPGA的步进电机控制器的设计，在分析步进电机的工作原理的基础上，给出了层次化设计方案与VHDL程序，并利用QuartusⅡ进行了仿真并给出了仿真结果。它以FPGA作为核心器件，极大地减少了外围元件的使用。同时...
基于Virtex-5 FPGA的音视频监视系统设计
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针对应用选择适合的器件多数音视频采集器件都支持单信道，以Y/Cr/Cb数据格式生成源同步数字信号。DSP虽然有能力采集数字音视频信号，也能够执行数字信号处理任务，但通常却仅支持少数几条信道。本设计选择了FPGA，...
基于FPGA的任意波形发生器设计与研究
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任意波形发生器的实现方案主要有程序控制输出、DMA 输出、可变时钟计数器寻址和直接数字频率合成（ DDS） 等多种方式 。目前任意波形发生器的研制主要基于DDS 技术， 与传统的频率合成器相比， DDS 具有低成本、低...
基于Verilog的DDS频率设置
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（1）时钟生成以及分频模块（clock_gen.v） （2）按键输入及消抖模块（fre_set.v） （3）并串转换模块（xs_1.v） （4）频率控制字产生模块（cz.v） （5）相位累加模块（leijia.v） 软件平台：Vivado设计套件，是FPGA...
基于AT89S52 单片的频率计
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件平台NanoBoard 结合时，用户可以快速、交互地实现和调试基于FPGA 的设 计，可以更换各种FPGA 子板,支持更多的FPGA 器件。 2.2.2 单片机程序设计开发工具：KEIL C51 keil c51 是美国Keil Software 公司出品的51 ...
NeoGeoHDMI:Verilog 项目从 Neo Geo MVS 获取数字视频和音频，然后通过 DAC 并通过 HDMI 输出信号
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FPGA 生成带有数据岛的 HDMI 视频信号以嵌入音频。 它还控制 Neo Geo MVS 的时钟，因此它可以在 60fps 的时序下产生 HDMI 规范要求的精确 720x480p。 有关更多详细信息，请参阅。 如果您已经基于旧版本的信息构建...
DSP接口电路设计与编程
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详细论述了DSP与多种外围接口电路的设计方法，包括各种存储器、模数和数模转换电路、异步串行接口、地址/数据复用总线、扩展I/O、CPCI总线，以及相关的软件编程和调试方法，还介绍了高速数字电路、数模混合电路的...
复旦nois教材01.rar
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2.2.7 生成Nios32 并把它加入到设计中......................................................................23 2.2.8 把符号（symbol）加入到BDF文件中..........................................................
DTMB标准的高速多码率LDPC编码器设计 (2012年)
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针对中国数字电视广播地面传输标准(DTMB)中给出的多码率LDPC码生成矩阵的特点，设计了一种串行输入串行输出基于流水线SRAA(Shift Register Adder Accumulator)结构的编码器，并同时适用于3种不同码率的LD PC码。...
行人惯性导航零速检测算法
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混合动力汽车基于规则的控制和ECMS与优化等效因子的实时能源管理策略
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基于CORDIC的反正弦和反余弦计算的FPGA实现
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本文重点研究在大型科学设施环境中工作的类似汽车的车辆的可行路径的生成。 考虑曲率连续性和最大曲率约束，一种新颖的路径平滑算法是根据三次贝塞尔曲线提出的。 在算法中，贝塞尔转弯和贝塞尔路径分别为发达。 Bezier 转弯首先设计用于连接两个任意配置。 然后可以通过以下方式获得贝塞尔路径使用贝塞尔曲线来拟合避免碰撞规划器提供的一系列目标点。 在算法的指导下，车辆可以以预定的方向到达目标点。 模拟实验进
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