基于嵌入式系统中DRAM控制器的CPLD解决方案

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介绍怎样在嵌入式CPU 80C186XL DRAM刷新控制单元的基础上,利用CPLD技术和80C196XL的时序特征设计一个低价格、功能完整的DRAM控制器的方法,并采用VHDL语言编程实现。

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weixin_38664427 你的留言是对我莫大的支持
2020-10-26
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