关于glbl.v如何仿真[Verilog]

所需积分/C币:16 2020-08-03 11:16:49 36KB PDF
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在FPGA设计中,glbl.v常用来定义全局复位/置位、全局三态信号和DUT的连接,并且用来为设计提供有效地复位信号,对设计中使用到的全局信号进行初始化。在仿真起始的100ns中,glbl将自动产生全局复位/置位。

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