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模数转换器时钟优化设计
模数转换器时钟优化设计
模数转换器
时钟优化
模拟电路
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在这里我们将讨论相关的时钟参数和方法以实现高速转换器预期的性能,为此要用到一些技术诀窍和经验。
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模数转换器时钟优化测试
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系统时钟优化可以提升系统的性能,但也颇具挑战性。为模数转换器设计抖动为350飞秒(fs)的编码电路是相对容易的,但这是否能够满足当今的高速需求? 在这里我们将讨论相关的时钟参数和方法以实现高速转换器预期的性能,为此要用到一些技术诀窍和经验。首先从典型的ADC时钟方案开始,如图1中所示,我们将焦点放在信号链路中每一级的可用于优化时钟的技术,并且指明一些应避免使用的常用技术。 图1.
模数转换器时钟优化
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在这里我们将讨论相关的时钟参数和方法以实现高速转换器预期的性能,为此要用到一些技术诀窍和经验。
模数转换器时钟优化:测试工程观点
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讨论相关的时钟参数和方法以实现高速转换器预期的性能,为此要用到一些技术诀窍和经验。首先从典型的ADC时钟方案开始,如图1中所示,我们将焦点放在信号链路中每一级的可用于优化时钟的技术,并且指明一些应避免使用的常用技术。
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AD9467是一款16位、单芯片、中频(IF)采样模数转换器(ADC),针对高性能、宽带宽和易用性而优化。这款产品以250 MSPS的转换速率工作,设计用于要求高动态范围的无线接收机、仪器仪表和测试设备。 该ADC要求采用1.8 ...
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