EDA/PLD中的一种基于FPGA的直接序列扩频基带处理器
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2020-12-09
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EDA/PLD中的一种基于中的一种基于FPGA的直接序列扩频基带处理器的直接序列扩频基带处理器
摘 要：本文设计实现了一种基于FPGA的直接序列扩频基带处理器，并阐述了其基本原理和设计方案。关键
词：扩频；FPGA；数字匹配滤波器；基带处理器引言扩频通信技术具有抗干扰、抗多径、保密性好、不易截获
以及可实现码分多址等许多优点，已成为无线通信物理层的主要通信手段。本文设计开发了一种基于直接序列
扩频技术(DS-SS)的基带处理器。 直接序列扩频通信直接序列扩频通信系统原理框图如图1所示。该处理器由
FPGA芯片，完成图1中两虚线框所示的基带信号处理部分。扩频方式为11位barker码扩频，采用自同步加扰技
术，支持最大数据速率为1.024Mbps的DBPSK和2.048Mbps的DQPSK两种
摘 要：本文设计实现了一种基于FPGA的直接序列扩频基带处理器，并阐述了其基本原理和设计方案。
关键词：扩频；FPGA；数字匹配滤波器；基带处理器
引言
扩频通信技术具有抗干扰、抗多径、保密性好、不易截获以及可实现码分多址等许多优点，已成为无线通信物理层的主要通信
手段。本文设计开发了一种基于直接序列扩频技术(DS-SS)的基带处理器。
直接序列扩频通信
直接序列扩频通信系统原理框图如图1所示。该处理器由FPGA芯片，完成图1中两虚线框所示的基带信号处理部分。扩频方式
为11位barker码扩频，采用自同步加扰技术，支持最大数据速率为1.024Mbps的DBPSK和2.048Mbps的DQPSK两种调制方
式，FPGA的主时钟频率为22.528MHz。
设计实现
该基带扩频处理器包括基带发送信号处理和基带接收信号处理两部分。
发送端实现方案
基带发送处理用FPGA实现，包括接收数据的加扰、串/并转换、差分编码、频谱扩展、脉冲成型和时序控制等电路模块，其总
体实现方案如图2所示。
数据加扰
本设计采用解扰时不需要复杂同步的自同步加扰技术，扰码器由7阶线性反馈移位寄存器构成。
串/并转换
该基带处理器支持DBPSK和DQPSK两种调制方式。当工作在BPSK方式时，数据以bit为单位进行处理，I/Q路数据相同。工作
在DQPSK方式时，传输数据以相邻的两bit为单位进行处理，其中奇数bit进入I通道，偶数bit进入Q通道，完成串/并转换的功
能。
差分编码
差分编码使PSK信号变成DPSK信号，以克服“相位模糊”问题。差分编码方案取决于调制方式是BPSK还是QPSK。当采用
BPSK方式时，编码运算比较简单：输出bit(k)由输入bit(k)异或输出bit(k-1)得到；采用QPSK方式时，因为四种可能的前一输
出状态和四种可能的当前输入状态可以确定十六种输出状态，所以差分运算方案比采用BPSK复杂的多，其编码方案如表1所
示。
频谱扩展
本设计选用自相关特性非常好的11位barker码作为扩频码，通过barker码和编码后的输出数据进行模二加实现扩频调
制，1.024Mbps 的I/Q路数据，经11.268Mbps的barker码扩频后变成11Mbps。
脉冲成型
为了更适合于信道传输的要求，需要经过波形成型后以压缩频带，减小码间干扰，同时使信号能量更加集中，增强信噪比。本
设计采用一个滚降系数a=0.22的升余弦FIR数字滤波器完成I/Q路信号的成型，经成型后的I/Q路数据作为基带处理器发送端的
输出数据送往外部调制器进行下一步处理。
接收端实现方案
基带接收处理同样用FPGA实现，包括AGC处理、前端处理(FEC)、数字匹配滤波器(DMF)、捕获跟踪、差分解调和自动频率
控制、并/串转换和解扰，以及时序控制等电路模块(见图3)。
基带AGC处理
AGC处理模块通过误差估计、低通积分和能量调整，并经D/A转换和滤波，调整接收信号的能量，使A/D转换输入的信号保持
最佳的电平值。必须注意，AGC环路是一个慢跟踪环路，不提供信号能量快速抖动的增益调整。
前端处理
前端处理电路由量化比特数转化和平滑处理两部分电路组成。
本文选用Maxim公司的MAX1198实现A/D转换，其量化比特数为8bit。量化比特数超过3bit时，输出信噪比仅有2dB的较小差
距。鉴于此，为避免硬件成本太高，用量化比特数转化电路将8bit表示的量化电平转化为3bit表示。
平滑处理电路利用PN码的游程分布特性，使DMF相关峰变得更加尖锐，有利于跟踪数据的变化，也充分利用了信号能量，经
平滑处理后进入DMF的数据为(rk+rk-1)/2。
捕获和跟踪
扩频序列的同步包括相位捕捉和相位跟踪，序列的捕捉完成后，尽管两相位达到一致，但是由于噪声、扩频序列时钟漂移等，
将会使相关峰的位置出现偏差，因此，本设计利用最大峰值的跟踪处理电路实现精确的扩频码同步。
实际系统中，由于振荡源频率漂移及多普勒频移的影响，相关峰的位置会发生变化，为了对数据符号进行有效的跟踪，该基带
处理器实现了一种“飞轮电路”(flywheel circuit)。它根据前一次成功检测到的峰值脉冲，自动为后一个峰值脉冲在时间上设置一
个“窗口”，它大约距上次脉冲一个符号时间，而宽度为前后各占一个基带采样时间。如果“窗口”中没有检测到相关峰，则该电
路会自动插入一个符号时钟脉冲，完成补脉冲的作用；如果“窗口”中检测到相关峰，则认为是第二个符号相关峰，即开窗后，
只对窗中的相关峰值进行检测，而窗口外的峰值则被当作噪声消掉，完成消脉冲的作用。
由于噪声和扩频序列自相关函数的影响，相邻码周期会出现相关峰的“托尾效应”，即窗中有多个大于门限1的相关值。为了跟
踪，这个电路在窗中的峰值脉冲中选择最高的一个作为相关峰，并把该时刻作为下一个符号的起始时刻。此外，飞轮电路还通
过计数实现同步检测和跟踪过程中的失步检测功能。
对于QPSK信号，有两种解调方式；相干解调(极性比较法)和差分相干解调(相位比较法)，一般相干解调比差分相干解调性能要
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