dds波形发生器(基于FPGA)

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所需积分/C币:50 2014-05-02 20:12:25 102KB DOCX
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基于FPGA的dds波形发生器 利用FPGA+DAC,设计一个DDS信号发生器。 要求:1. 分辨率优于0.1HZ 2. ROM长度8位、位宽8位 3. 输出频率:10HZ~60KHZ(每周期>=50个点) 4. 显示信号频率(16进制显示,低频时至少含一位小数) 5. 直接输入频率控制字

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soar-zed 感觉没什么用
2020-05-22
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pht1991 很好的资料,学习
2017-04-11
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