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数字系统设计与Verilog HDL(第4版)[王金明] 评分:

数字系统设计与Verilog HDL(第4版)[王金明]

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2014-03-17 上传 大小:5.18MB
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u010019113 这个积分有点高了,觉得一般!
2019-04-29
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qq_36337566 不是pdf,怎么是PPT?
2018-05-17
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kid_0203 还可以。。。。。。。
2018-03-12
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baidu_27565169 资源很好!
2018-02-02
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liujunjiejjjj 看着很不错,值得下载
2017-10-30
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Verilog HDL是硬件描述语言的一种,用于数字电子系统设计。它允 许设计者用它来进行各种级别的逻辑设计,可以用它进行数字逻辑系统的 仿真验证、时序分析、逻辑综合。它是目前应用最广泛的一种硬件描述语 言。据有关文献报道,目前在美国使用Verilog HDL进行设计的工程师大 约有60000人,全美国有200多所大学教授用 Verilog 硬件描述语言的设 计方法。在我国台湾地区几乎所有著名大学的电子和计算机工程系都讲授 Verilog有关的课程。

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本书 的定位 是作为 EDA 技术、 FPGA 开发或 数字设 计方面 的教材 。在 编写的 过程中 ,遵 循 的是重 视基础 、面向 应用的 原则, 力图在 有限的 篇幅内 ,将 EDA 技术与 FPGA 设计 相关的 知识简 明扼要 、深 入浅 出地进 行阐述 ,并融 入作者 在教学 、科 研中 的实践 经验。

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