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verilog电话号码流水显示 评分:

verilog电话号码流水显示,已成功实现
2013-06-09 上传大小:192KB
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MIPS五级流水线CPU(verilog实现)

计算机组成原理课程实验:一个MIPS五级流水线CPU 内含全部源代码和实验文档,verilog实现,开发平台为ISE

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CPU五级流水线verilog源代码

使用了verilog写的五级流水线。处理过了hazard,还有stall。

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MIPS五级流水线的verilog实现

使用verilog实现MIPS经典的五级流水线,巧妙的解决结构冒险、数据冒险、控制冒险。

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FPGA学号显示流水灯,单多个数码管显示完整集成程序

通过FPGA的verilog显示学号,同时有流水灯和矩阵键盘程序

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基于mips的5级流水cpu verilog

基于mips的基本5级流水线cpu verilog实现 有结构图

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基于MIPS指令集的32位CPU设计与Verilog语言实现_流水线CPU

用Verilog语言设计的流水线CPU,资源里包含了源代码及流水线CPU结构图,与大家分享下。

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FPGA流水呼吸灯verilog HDL设计

该程序是基于FPGA verilog HDL设计的一个流水呼吸灯的设计(4个LED实现流水和呼吸的效果),适合初学者学习,博客: https://blog.csdn.net/qq_40261818/article/details/81360202

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五级流水线MIPS指令集cpu设计,verilog语言,通过modelsim与ISE并下载FPGA验证(计算机组成原理)

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hash的sha1的verilog程序

sha1算法的verilog程序。请需要的同学下载。

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32位CPU Verilog 代码

32位的cpu verilog 源码,希望对开发cpu架构的硬件工程师有所帮助。

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关于verilog流水线设计的精华

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verilog 实现的0-9 计数器数码管显示

verilog 0-9计数器数码管显示,在实验箱上进行过测试的!!

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五级流水线CPU完整设计(包括control hazard和data hazard处理)

建议师弟师妹们还是要自己写,完整地理解好CPU设计的思路,不要直接在网上找到就抄。http://blog.csdn.net/c602273091/article/details/35883557 大家可以到师兄博客看一下hazard解决的思路分析。

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Verilog动态数码管显示十进制

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通过Verilog实现数码管显示驱动实验报告

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异步控制方式的硬布线控制器(vhdl)

使用vhdl编写的异步控制方式的硬布线控制器

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FPGA verilog语言流水灯实验

用verilog语言编写的流水灯程序,已经在altera cyclone IV板子是测试成功。程序里用了4个LED灯。流水灯流动的速度可以自己设定。

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8点FFT Verilog流水实现,亲测可用

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计数器在fpga实验版上实现4位7段数码管动态显示,数字递增

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