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Verilog_HDL_那些事儿_时序篇 评分:

Verilog_HDL_那些事儿_时序篇

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2011-11-30 上传 大小:7.34MB
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评论 下载该资源后可以进行评论 共3条

xiao23xiao 对我们这种初学者 蛮好用的
2014-04-25
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xuzuqianglifei 内容偏简单,适合初学者
2013-01-10
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shadowsong2012 适合初学者,很不错
2012-10-30
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verilog十大基本功

最近对国内的主要EDA 论坛做了一项调查,耗时一个多月,经过仔细的总结,发现一个有趣的现象:国内关于HDL 提出问题的帖子,有80%都集中在一小部分基本问题上。同样的一个问题,从5 年前开始就有人问起,一直问到今天,很可能还会持续到N 年后。貌似新人们总也避不开这些说难其实也不难的问题,而且实际的调查还发现,就连好多工作多年的工程师们对这些问题也是稀里糊涂,似懂非懂。为了帮助大家一劳永逸解决这些基本难题,从而迈向自由编程的康庄大道,我们特地开辟了这个版块,要把这些基本功一一传授给大家。如果觉得我们的帖子还不过瘾,你可以回帖继续提问,务必把所有概念搞清搞懂。另外所谓十项只是一个概述,请勿过分计较

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verilog那些事儿 nios2篇

黑金的资料,主要适合那些有一定FPGA基础的人,对nios的讲解比较独到,刚接触nios的话,这是个不错的参考

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