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作者:CSDN
出版社:CSDN《程序员》
ISBN:1111111111117
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systemverilog数字系统设计 评分:
《SystemVerilog数字系统设计》是2011年2月1日电子工业出版社出版的图书,作者是茨沃林斯基。
上传时间:2018-08 大小:117.82MB
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2011-03-24systemverilog经典教程,很有用!!!
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2017-10-01SystemVerilog for Verification teaches the reader how to use the power of the new SystemVerilog testbench constructs plus methodology without requiring in-depth knowledge of Object Oriented Programming or Constrained Random Testing. The book covers the SystemVerilog verification constructs such as classes, program blocks, C interface, randomization, and functional coverage. SystemVerilog for Verification also reviews some design topics such as interfaces and array types. There are extensive code examples and detailed explanations. The book will be based on Synopsys courses, seminars, and tutorials that the author developed for SystemVerilog, Vera, RVM, and OOP. Concepts will be built up chapter-by-chapter, and detailed testbench using these topics will be presented in the final chapter. SystemVerilog for Verification concentrates on the best practices for verifying your design using the power of the language.
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