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基于CPLD和单片机的等精度频率计的设计
基于CPLD和单片机的等精度频率计的设计
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CPLD
FPGA
VHDL
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用CPLD和单片机做的频率计
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完整报告,有源程序 测量范围要求 1Hz-10MHz(输入信号幅度为0.5V-5V)。 基本性能要求 f为10MHz时,频率绝对误差不大于1000Hz; (高频精度) f小于1000Hz时,频率绝对误差不大于1Hz。 (低频精度) 提高性能要求 高频精度提高: f为10MHz时,频率绝对误差不大于100Hz。 低频精度提高:f小于1000Hz时,频率绝对误差
基于单片机和CPLD的等精度频率计的设计
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能够实现,管教配置另外上传。
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基于CPLD及C语言的等精度频率计设计 的
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参考资料-基于CPLD和单片机的等精度数字频率计设计.zip
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基于单片机和CPLD的数字频率计的设计(图)
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在传统的控制系统中,通常将单片机作为控制核心并辅以相应的元器件构成一个整体。但这种方法硬件连线复杂、可靠性差,且在实际应用中往往需要外加扩展芯片,这无疑会增大控制系统的体积,还会增加引入干扰的可能性。对一些体积小的控制系统,要求以尽可能小的器件体积实现尽可能复杂的控制功能,直接应用单片机及其扩展芯片就难以达到所期望的效果。
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专业设计参考文献,具有一定的参考价值,请下载。
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CPLD.zip_cpld 频率计_lionbk8_等精度频率计
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基于CPLD的等精度频率计的单片机程序,用的是EPM5701T00C5芯片
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