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7进制加法计数器.ms13
7进制加法计数器.ms13
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7进制加法计数器.ms13
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同步八进制加法计数器.ms7
本电路实现了同步八进制加法计数器的功能: 电路能准确地按照八进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
同步十进制加法计数器(JK).ms7
本电路实现了同步十进制加法计数器的功能: 电路能准确地按照十进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
同步三十二进制加法计数器.ms7
本电路实现了同步三十二进制加法计数器的功能: 电路能准确地按照三十二进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
同步四进制加法计数器(JK).ms7
本电路实现了同步四进制加法计数器的功能: 电路能准确地按照四进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
2-80 同步10进制加法计数器.ms9
基于Multisim软件的同步10进制加法计数器,采用的芯片是74ls76D,Multisim软件是10以上均可以使用
同步十六进制加法计数器.ms7
本电路实现了同步十六进制加法计数器的功能: 电路能准确地按照十六进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
同步七进制加法计数器.ms7
本电路实现了同步七进制加法计数器的功能: 电路能准确地按照七进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
同步置数法接成的六进制加法计数器.ms7
用74160以同步置数法实现了同步六进制加法计数器的功能. 掌握74160的应用方法对于提升电路设计效率有着十分重要的作用.
异步六进制加法计数器(上升沿触发).ms7
本电路实现了异步六进制加法计数器的功能. 该设计思路用观察时序图的方式求出时钟方程, 再根据时钟取值修改状态表, 之后再求出状态激励方程(D触发器).
同步十进制加法计数器(D).ms7
本电路实现了同步十进制加法计数器的功能: 电路能准确地按照十进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
Multisim仿真实例电路仿真实验Multisim模拟电子仿真实验150个+Multisim数字电子仿真实验150个.zip
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Multisim仿真实例电路仿真实验Multisim模拟电子仿真实验150个+Multisim数字电子仿真实验150个,过零比较器.ms8,共发射极简单....2-44 二-十进制译码器74LS42.ms9,2-80 同步10进制加法计数器.ms9等共计300个仿真文件。
同步六进制加减法可逆计数器(JK).ms7
本电路实现了同步六进制加减法可逆计数器的功能: 电路能准确地按照六进制加法或减法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
同步六进制加减法可逆计数器(D).ms7
本电路实现了同步六进制加减法可逆计数器的功能: 电路能准确地按照六进制加法或减法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.
清华大学数字技术基础全套实验 Multisim 仿真
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清华大学数字技术基础全套实验 Multisim 仿真 数字电路部分
ewb multisim 仿真实例电路图全集
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多年收集的ewb和multisim电子电路仿真实例文件,压缩后有50多兆。 文件列表 ...│ │ 2-76 用T'触发器构成的同步2进制加法计数器4520.ms9 │ │ 2-77 用T触发器构成的同步2进制减法计数器.ms9 │ │ ...
74160功能实验.ms7
掌握同步十进制加法计数器74160的使用方法十分重要, 本文件对74160的四种功能进行了实验. 读者应仔细研究74160芯片的使用方法, 以为设计更复杂的计数电路做铺垫.
74LS90篮球正数计时器.ms14
用集成异步计数器 74LS90 74LS90 是异步二 —五—十 进制加法计数器,设计的一个简单的篮球计时器,该计时器清零存在一点小问题
74LS138功能分析.ms7
本电路以同步八进制加法计数器的三个输出作为3-8译码器 74LS138的三个输入, 通过逻辑分析仪模拟出每组输入对应的输出, 使读者直观地理解3-8译码器的工作过程.
74138扩展5-32线译码器.ms7
本电路用四片74LS138和一片74LS139实现了5-32线译码器的功能, 并以同步三十二进制加法计数器的5个输出作为5位译码输入, 验证了设计的5-32译码器的功能.
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