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hdb3的Verilog HDL编码 评分:

 针对数字基带传输系统中HDB3信号的特点,采用基于FPGA的Verilog HDL语言,实现HDB3数字基带信号的编码器设计,共有插V、插B、单双极性变换模块,最终能在FPGA实现。
2017-12-21 上传大小:322KB
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基于Verilog 的HDB3 的编译码器设计
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通信原理---FPGA---HDB3码编码
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HDB3编解码,ise工程文件,已实现,module HDB3_jiema(data,HDB3,clk ); output data; input [1:0] HDB3; input clk; wire [1:0] HDB3,out; moveVB module1(out,HDB3,clk); switch_yima module2(data,out,clk); endmodule

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