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基于altera FPGA 的 UART IP核 评分:

使用verilog HDL语言编写的串口IP核,经过波形仿真验证
2010-10-06 上传大小:1.48MB
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评论 共18条

chenlu7945137 还没有用,先谢谢了
2018-04-06
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qq_38786398 挺好的,给个赞
2018-03-27
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lp1234567 还是不错的
2018-01-18
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huimeiju1277 非常完整,666
2017-10-12
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cul627 谢谢,写的还是挺清晰的
2016-12-02
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u011169492 看起来东西挺多,还没怎么用
2016-11-15
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smltljsh 感觉不怎么好用,不过可以参考参考!
2016-08-08
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songjie217 超级完整版的串口核,不过一般用不了这么全的功能,挺好的
2016-04-28
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u011166282 没怎么用,感觉不好用
2016-02-24
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fredfong 可用参考使用,很好
2015-09-17
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【FPGA】【Verilog】【基础模块】UART
UART IP(verilog代码及说明文档)

使用verilog HDL语言编写的串口IP核,其中的全部代码,经过波形仿真验证,内附说明文档,已经过仿真,可完美运行。

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