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fifo to uart 评分:

VHDL 带fifo的uart 源代码,求大神帮忙修改。
2012-10-08 上传大小:2KB
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uart fifo的fpga程序

verilog编写的 uart通信程序,包括对fifo的控制,程序简单精炼,在开发板得到验证

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verilog实现的带FIFO的UART模块

verilog实现的带FIFO的UART模块,代码风格良好,模块化,具有较高的参考价值。

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基于verilog的带fifo的串口设计

使用verilog开发的带fifo的串口,波特率115200,8,n,1,已在fpga上验证通过。

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TI DSP 28335 串口FIFO中断接收程序

TI DSP 28335 串口FIFO中断接收程序 打开后在工程添加文件中的comm_2int_fifo.c文件即可。 该文件已经本人调试成功可用。

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verilog实现含FIFO的RS232串口收发程序源代码

verilog实现含FIFO的RS232串口收发程序 环境quartus 8.1 以上

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fifouart数字课程设计

带有fifo的uart数字电路课程设计,可以直接运行,

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STM32进阶之串口环形缓冲区实现 FIFO

STM32进阶之串口环形缓冲区实现 FIFO,代码精简,易实现。

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S32K144_Uart

S32K144 自身NorFlash读写,在NXP官方编译器S32 Design Studio for ARM Version 2018.R1(需要打补丁跟新到 RTM2.0版SDK)直接编译。该串口代码与官方库不冲突,可继续使用官方提供的便利工具,IO和Uart模块的可视化配置,并且实现Uart方便的中断接受,不丢失。从FIFO中直接提取数据,改善官方SDK库效读取率低,操作不方便等问题。

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UART实现Verilog版

该代码实用Verilog实现UART功能,为Xilinx公司的设计实例。

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LPC2124 UART FIFO实验

一个lpc做发送,以4字节为单位 一个lpc做接收,设置不同的触点 能够发现FIFO 触点为0的时候也是有用的 和不使用FIFO不同 实验证明以上结论

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不带FIFO的uart

首先介绍UART硬件接口及电平转换电路,分析UART的传输时序并利用Verilog HDL语言进行建模与仿真,最后通过开发板与PC相连进行RS-232通信来测试UART收发器的正确性。

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The Secrets of UART FIFO

在网上看到的很好的一篇关于UART FIFO使用的文章,英文原版,分析的很细致。

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带FIFO的UART

VHDL实现UART,比较完善了。带FIFO的,接收和发送都有。有根据自己理解写的注释。

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1SC16C2552B——带16字节FIFO的双UART器件

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S3C2410 uart 中断收发

ARM9 S3C2410 UART 驱动程序 使用FIFO 和 中断 进行数据收发

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用 verilog语言设计UART 带FIFO 32位

用 verilog语言设计UART 带FIFO 32位 可以参考下

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Implementation of a Multi-channel UART Controller Based on FIFO Technique

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基于vhdl的UART的ip核

基于vhdl的UART的ip核,带16字节的fifo,好用!

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esp8266的Uart使用说明文档

这是一份esp8266的uart操作文档,说的比较详细,具体到如何设置uart,如何发送,中断设置,fifo等等,最后以一个具体编程实例说明,很好!

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FIFO代码以及对应的testbench

这个是vivado写的Verilog代码,主要是实现FIFO的功能,还有一些是自己的测试testbench

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