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verilog 奇数倍分频
verilog 奇数倍分频
verilog
奇数倍分频
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2014-10-27
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用verilog写的奇数倍分频程序,如3分频,5分频等等
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利用Verilog实现奇数倍分频
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分频器是FPGA设计中使用频率非常高的基本设计之一,尽管在目前大部分设计中,广泛使用芯片厂家集成的锁相环资源,如赛灵思(Xilinx)的DLL.来进行时钟的分频,倍频以及相移。但是对于时钟要求不高的基本设计,通过语言进行时钟的分频相移仍然非常流行,首先这种方法可以节省芯片内部的锁相环资源,再者,消耗不多的逻辑单元就可以达到对时钟操作的目的。另一方面,通过语言设计进行时钟分频,可以看出设
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N倍奇数分频器的verilog程序,详细讲解原理。
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