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用FPGA实现数字跑表功能

利用VerilogHDL语言在FPGA开发板上面实现利用数码管显示0到99的跑表功能。
2018-04-16 上传大小:36KB
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qq_41979946 什么格式的,看不了啊
2018-11-12
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verilog 实现数字跑表

如果你是肥大学子,在做verilog课程设计,不用再看了,这就是你需要的! 此版本word内部为程序的截屏,程序需要自己敲进电脑。若不想自己敲代码,清下载我上传的另一版本。 功能描述:此数字跑表由三个按键控制,按键功能如下: SW1:实现暂停、开始以及数据的保存 SW2:实现清零 SW3:实现已保存数据的显示

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Verilog HDL 数字跑表

verilog HDL 数字跑表 源程序 适用于 verilog HDL初学者 verilog HDL 数字跑表 源程序也可以用于课程设计

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支持一小时正数倒数计时,具有蜂鸣器秒响功能,暂停开始功能等

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Verilog实现数字跑表实现

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