wilson_chen/HDLGen
verilog
HDLGen是一个HDL/RTL生成工具，支持在Verilog里内嵌Perl或Python script来帮助快速、高效地生成期望的设计，支持Perl或者Python的所有数据结构和语法，有若干内嵌函数来提高效率，也支持扩展API，支持自动Instance、自动信号生成、IPXACT、JSON、XML、模板等输入来减少手动工作、提高开发效率、降低出错几率，大大提高IP开发和SOC集成的效率
1726529464.475643
upload.zip （57个子文件） 
HDLGen.pl 7KB HDLGen.bin 8.48MB
plugins RstGen.pm 3KB HDLGenIpxIntf.pm 36KB HDLGen.pm 74KB ClkGen.pm 3KB AsyncIntfGen.pm 3KB FuseGen.pm 3KB FifoGen.pm 4KB eFuncPrint.pm 2KB Design_Template Mem.tmpl.v 3KB AsyncFifo.tmpl.v 6KB AsyncIntf.tmpl.v 4KB Pmu.tmpl.v 3KB Clk.tmpl.v 3KB Fuse.tmpl.v 3KB SyncFifo.tmpl.v 6KB Rst.tmpl.v 3KB PmuGen.pm 3KB eFunc.pm 2KB MemGen.pm 3KB doc 
WorkingFlow.PNG 201KB AutoDef_Sample.PNG 91KB AutoWarning_Sample.PNG 233KB Instance_Sample.PNG 523KB Design_Template_Sample.PNG 197KB JSON_Sample.PNG 377KB
HDLGen_Intro_En.pdf 2.57MB AutoInstSig_Sample.PNG 101KB IPXACT_Sample.PNG 216KB setenv.sh 25B README.cn.md 10KB LICENSE 11KB Change_History 5KB test incr test_sys_ctrl_apb_regs.v 5KB NV_NVDLA_CMAC_CORE_MAC_nan.v 40KB NV_NVDLA_CMAC_CORE_MAC_mul.v 20KB NV_NVDLA_CMAC_CORE_MAC_exp.v 74KB apb_test.v 5KB test_DAC.v 9KB NV_NVDLA_CMAC_CORE_mac.v.Ref 179KB cfg Rst_Cfg.json 128B SFifo_Cfg.json 183B MyIntf.json 129B AsyncIntf_Cfg.json 142B Regs.json 1KB simple_spi.xml 18KB Mem_Cfg.json 147B APB.xml 4KB Clk_Cfg.json 378B my_test_design.JSON 1KB AFifo_Cfg.json 187B Fuse_Cfg.json 75B Pmu_Cfg.json 101B NV_NVDLA_CMAC_CORE_mac.vp 27KB src.list 29B
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