Verilog HDL的基本语法

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chenyiwo
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内容简介:第三章 Verilog HDL 基本语法--------------------------------------------------------------------------------------------------------------------------------------------------第三章 Verilog HDL的基本语法前言Verilog HDL是一种用于数字逻辑电路设计的语言。用Verilog HDL描述的电路设计就是该电路的Verilog HDL模型。Verilog HDL既是一种行为描述的语言也是一种结构描述的语言。这也就是说,既可以用电...