基于fpga的抢答器(verilog)

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1, 用了3个输入代表抢答按钮,如果想设置更过直接更改; 2, 初始时倒计时为10s; 3, 如果倒计时为10s没人抢答,按下复位键,重新开始抢答; 4, 在倒计时10s内有人抢答,则倒计时停止减一; 5, 序号显示的是第一个抢答的人对应的序号,其他人抢答无效; 6, 按下复位键,重新开始抢答。

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@小聂同学 这个还可以哈哈
2019-06-15
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习惯啊就好了 好像还凑合
2019-06-11
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FAE-Riven 程度有点乱.有些东西多余的
2015-04-04
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wodeyijia 程序作用不大吧,不是很适合,没有设计思路
2013-12-28
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神奇的斌 程度有点乱.有些东西多余的
2013-12-25
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niubomian 程序很有用,很有帮助,谢谢 .要是verilog\就好了
2013-08-06
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hitflame 程序很有用,很有帮助,谢谢
2013-07-13
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