1.十四进制减法同步计数器
1.1 设计原理
计数器的功能是记忆脉冲的个数,它是数字系统中应用最广泛的基本时序逻辑构件。计
数器所能记忆脉冲的最大数目称为该计数器的模,用字母 M 来表示。构成计数器的核心元件
是触发器。
计数器的种数繁多,分类方法也不同。①按计数功能来分,可分为加法计数器、减法计
数器、可逆计数器;②按进位基数来分,可分为二进制计数器(模为 2
r
的计数器,r 为整数),
十进制计数器,任意进制计数器;③按进位方式来分,可分为同步计数器(又称并行计数器) ,
异步计数器 (又称串行计数器)。
同步计数器电路中,所有触发器的时钟都与同一个时钟脉冲源连在一起, 每一个触发器
的状态变化都与时钟脉冲同步。
1.2 设计步骤
1.2.1 真值表
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