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基于VHDL的4位二进制乘法器 评分:

用VHDL语言做的4位二进制乘法器,编写用的是QuartusII软件。调用了寄存器,加法器,计数器。外加状态机,用原理图实现顶层的编写。
2009-01-17 上传大小:259KB
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评论 共3条

u011053275 不错,对我学习组成原理很有帮助
2013-12-15
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wonderfulwyq97 不够详细,还缺点标注
2012-11-12
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puliapushi good,可惜还差个word文档和每个元件的标注
2011-10-30
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四位二进制乘法器(eda实验)

使用vhdl实现四位二进制数值的相乘 vhd文件可以使用文本文档打开

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基于verilog HDL语言的4位二进制乘法器的设计,其功能是快速、可靠的实现二进制乘法操作。

Based on verilog HDL language 4-bit binary multiplier design, its function is fast and reliable to achieve binary multiplication operation.

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4位乘法器的设计

4位二进制乘法器电路

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4位二进制乘法器的FPGA实现

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Verilog语言实现4位移位乘法器
四位乘法器的VHDL语言设计

本文档说明了如何用VHDL语言设计出四位乘法器,有详细的代码和总结说明.

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verilog 4位乘法器

Verilog 4位乘法器设计实现4位二进制数的乘法运算

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任意N位和M位的乘法器VHDL实现(代码)

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