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数字系统仿真VHDL设计课程实验

2009-05-18 上传大小:556KB
数字系统仿真VHDL设计课程实验,附实验源代码
实验一. 分频器设计
实验二. VHDL描述风格比较
实验三. 4位可逆计数器
实验四. 7段数码管译码器设计与实现
实验五. 状态机代码验证
实验六. 序列检测器的设计
实验七. 基于ROM的正弦波发生器的设计
实验八. 数字密码锁的设计与实现
实验九. 数字频率计的设计
附录. Altera DE2常用管脚
综合评分:4(1位用户评分)
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评论共有1条

zhyymsjtu 2011-12-07 22:39:41
不全 有1、4、5、6、8、9

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