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FPGA贪吃蛇游戏Verilog VGA显示屏 Vivado
FPGA贪吃蛇游戏Verilog VGA显示屏 Vivado
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FPGA
Verilog
VGA显示屏
数字逻辑
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2020-08-09
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数字逻辑大作业 FPGA贪吃蛇游戏,Vivado开发,Verilog语言实现,结合VGA显示屏外设,NEXY4下板成功
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(11个子文件)
vga.v
1KB
Display.v
4KB
Eatting.v
817B
topofsnake.v
2KB
snake_tb.v
1KB
vga_unit.v
2KB
topofsnake.bit
3.65MB
clk_unit.v
393B
Key.v
1KB
CtrlGame.v
2KB
Snake.v
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m0_73912003
2023-12-18
博主能发一下顶层模块吗,真的急需,谢谢博主了。2079185324@qq.com
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