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第 4 章 存储映射
4.1 概要
本芯片包含多种存储器和外设存储映射,位于一个 32 位的连续内存空间里。
本章节将详细的介绍存储和外设地址的存储空间。
4.2 系统存储映射
下表显示了高级设备存储映射。
表 4-1 系统存储映射
注意
系统 32 位地址排列
目标从机
访问
0x0000_0000–0x0FFF_FFFF
可编程 flash 和只读数据(包括一开始 1024 字节的
异常中断向量)
All masters
0x1000_0000–0x13FF_FFFF
• For MK60N256VLQ100: 保留
• For MK60X256VLQ100: FlexNVM
• For MK60N512VLQ100: 保留
• For MK60N256VMD100: 保留
• For MK60X256VMD100: FlexNVM
• For MK60N512VMD100: 保留
All masters
0x1400_0000–0x17FF_FFFF
对于带有 FlexNVM 的芯片: FlexRAM
对于只有可编程 flash 的芯片: 编程加速内存
All masters
0x1800_0000–0x1FFF_FFFF
SRAM_L: Lower SRAM (ICODE/DCODE)
All masters
0x2000_0000–0x200F_FFFF
SRAM_U: Upper SRAM bitband region
All masters
0x2010_0000–0x21FF_FFFF
保留
–
0x2200_0000–0x23FF_FFFF
Aliased to SRAM_U bitband
Cortex-M4
core only
0x2400_0000–0x3FFF_FFFF
保留
–
0x4000_0000–0x4007_FFFF
外设桥 0 (AIPS-Lite0)
Cortex-M4
core &
DMA/EzPort
0x4008_0000–0x400F_EFFF
外设桥 1 (AIPS-Lite1)
Cortex-M4
core &
DMA/EzPort
0x400F_F000–0x400F_FFFF
通用输入输出(GPIO)
Cortex-M4
core &
DMA/EzPort
0x4010_0000–0x41FF_FFFF
保留
–
0x4200_0000–0x43FF_FFFF
外设桥 (AIPS-Lite) 和 通用输入输出 (GPIO)
Cortex-M4
core only
0x4400_0000–0x5FFF_FFFF
Reserved
–
0x6000_0000–0xDFFF_FFFF
Flexbus
All masters
0xE000_0000–0xE00F_FFFF
私有外设
Cortex-M4
core only
0xE010_0000–0xFFFF_FFFF
Reserved
–
1. EzPort 主机端口和 DMA 主机端口复用。到 AIPS-Lite 外设桥和 GPIO 模
块地址空间限制的访问权限受限于内核、DMA 和 EzPort。
2. ARM Conrtex-M4 内核访问也包含调试接口。
4.2.1 位带别名区
SRAM_U,AIPS-Lite 和 GPIO 模块资源依附于 Cortex-M4 内核位带别名区。
处理器包含两个 32MB 位带别名区,与两个 1MB 的位带别名区相连。每个
32 位的 32MB 空间有自己独立的位带别名区。在混合区的 32 位写操作和位宽区
的读写操作一样。
写到位带别名区的值的第 0 位有如下作用:
· 写 1 到第 0 位是用于置位。
· 写 0 到第 0 位是用于清零。
从混合区读数据:
· 0x0000_0000 是清零。
· 0x0000_0001 是置位。
图 4-1 混合位宽映射
4.3 Flash 存储映射
各种 Flash 存储和 Flash 寄存器位于不同的基址。如下图所示。
图 4-2 只包含可编程 flash 存储映射
图 4-3 包含 FlexNVM 的存储映射
4.3.1 交替非易失性 IRC 用户修剪说明
为防止自定义 IRC 用户通过一些开发工具裁剪,系统保留了由以下非易失
性位(4 字节)。在该位上可以储存工厂裁剪的交替 IRC 裁剪信息。如果想要覆
盖出厂值,用户的软件必须加载新的值到 MCG 裁剪寄存器。
4.4 SRAM 存储映射
片上 RAM 分为 SRAM_L 和 SRAM_U。同时 SRAM_L 和 SRAM_U 是连续
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wanghl477
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