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32位超前进位加法器(Verilog)

2009-11-26 上传大小:23KB
32位超前进位加法器(Verilog HDL),由8个四位超前进位生成。
综合评分:4.2(39位用户评分)
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评论共有9条

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aa862698382014-10-02 03:48:21
描述有误导,不算完全超前进位。有兴趣的同学可以自己找找超前进位的教程,可以根据他的子模块自己写一个
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liykxy522013-11-10 22:29:08
真是超前进位吗?怎么结果和我预想的不对啊!求解!
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cforever_199202162013-11-01 15:34:04
确实可以,但是不是我想要的结构
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peiningxin2013-03-04 14:35:04
采用的是八个四位的超前进位加法器拼起来的,应该算是超前进位加法器吧,前面的评论是不是没看清啊。
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ji9ko02013-01-18 21:18:18
不是超前进位的…坑死
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lilebuhao2013-01-01 19:20:03
真的只是加法器,不是超前进位的
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lazerylee2012-11-13 23:07:38
只是加法器,不是超前进位的
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zwl7739932212012-09-04 18:29:09
老大,你的写作规范的概念不强哟,亟待改进哟,不过楼主的精神可嘉!我这里有个更好的,也不是更好,只是这个有注释,能让初学者看得懂,,还是要感谢楼主的!
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koprenee2011-12-13 15:47:05
不是超前进位的

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