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高性能除法电路设计与实现

2009-05-18 上传大小:229KB
: 比较了当今主流处理器中除法器的几种算法, 通过分析, 得知 SRT 运算的硬件结构简单、 面积小、 功耗小。对
SRT 算法进行了改进, 使用了两级重叠基 - 2 使其变化为基 - 4 的方法, 速度较普通的基 - 2 算法提高了 1 倍, 而硬件代价
却远小于基 - 4 的方法。用 verilog 语言对其进行了描述,modelsim 进行了功能仿真验证, synplicity 进行综合。结果表明该
电路具有较好的速度、 面积和功耗的折衷。该除法器可以广泛地应用到各种嵌入式和通用处理器中, 有很高的实用价值
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评论共有1条

alice_1111 2012-07-25 16:50:56
帮助理解概念,不适用于我遇到的情况

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