//*************************640*480@60Hz*25MHz**********************************************
// Horizontal Parameter ( Pixel )
parameter H_SYNC_CYC = 96;
parameter H_SYNC_BACK = 45+3;
parameter H_SYNC_ACT = 640; // 646
parameter H_SYNC_FRONT= 13+3;
parameter H_SYNC_TOTAL= 800;
// Virtical Parameter ( Line )
parameter V_SYNC_CYC = 2;
parameter V_SYNC_BACK = 30+2;
parameter V_SYNC_ACT = 480; // 484
parameter V_SYNC_FRONT= 9+2;
parameter V_SYNC_TOTAL= 525;
// Start Offset
parameter X_START = H_SYNC_CYC+H_SYNC_BACK;
parameter Y_START = V_SYNC_CYC+V_SYNC_BACK;
//*******************XGA(1024*768)@60Hz desired clock 65M*******64.8********************************/
// Horizontal Parameter( Pixel )
/*
parameter H_SYNC_CYC = 136;
parameter H_SYNC_BACK = 160;
parameter H_SYNC_ACT = 1024;
parameter H_SYNC_FRONT= 24;
parameter H_SYNC_TOTAL= 1344;
// Virtical Parameter ( Line )
parameter V_SYNC_CYC = 6;
parameter V_SYNC_BACK = 29;
parameter V_SYNC_ACT = 768;
parameter V_SYNC_FRONT= 3;
parameter V_SYNC_TOTAL= 806;
// Start Offset
parameter X_START = H_SYNC_CYC+H_SYNC_BACK;
parameter Y_START = V_SYNC_CYC+V_SYNC_BACK;
*/
Verilog HDL实现了使用WM8731对音频进行采样，并且使用ALTERA FPGA实现了频谱计算（FFT），在VGA上显...
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2017-06-15
12:32:40
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Verilog HDL实现了使用WM8731对音频进行采样，并且使用ALTERA FPGA实现了频谱计算（FFT），在VGA上显示频谱.zip （32个子文件） 
audio_fft_vga 
AUDIO_FFT_VGA.qsf 9KB CFFT rofactor.vhd 3KB cfft1024X12.vhd 4KB address.vhd 9KB sc_corproc.vhd 3KB p2r_CordicPipe.vhd 4KB blockdram.vhd 2KB cfft.vhd 8KB div4limit.vhd 2KB mulfactor.vhd 3KB p2r_cordic.vhd 3KB cfft4.vhd 4KB VGA_Param.h 1KB RAM_DUALPORT_1024X16.v 9KB Reset_Delay.v 366B mult.qip 0B RAM_DUALPORT_1024X16.qip 207B Audio_PLL.qip 279B FIFO_16_1024.qip 193B FIFO_16_1024.v 8KB I2C_AV_Config.v 5KB AUDIO_FFT_VGA.v 5KB Audio_PLL.v 16KB mult_add.qip 196B VGA_Controller.v 3KB I2C_Controller.v 4KB SRAM_16Bit_512K.v 809B Audio_PLL.ppf 487B MDELETE.bat 264B mult_add.v 16KB AUDIO_FFT_VGA.qpf 1KB AUDIO_DAC_FIFO.v 4KB
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